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Billy Jiang's profile - activity

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2021-05-20 03:54:35 -0600 received badge ● Notable Question (source)
2021-05-20 03:54:35 -0600 received badge ● Popular Question (source)
2020-08-18 06:52:58 -0600 received badge ● Enthusiast
2020-08-11 00:13:27 -0600 answered a question Intel 10M JTAG下载失败可能有哪几种原因？

JTAG线缆坏了，JTAG下载器降速 10M是否使用PCIE IP，如果使用PCIE，需要确认PCIE参考时钟是否先提供。 10M DIB在两个die中配置不正确，会导致U1/U2同时下载失败。 https://www.intel.com
2020-08-11 00:07:51 -0600 asked a question Intel 10M JTAG下载失败可能有哪几种原因？

Intel 10M JTAG下载失败可能有哪几种原因？ 10M JTAG下载sof文件，为什么会失败？

2020-08-10 23:57:17 -0600 edited answer quartus 软件宏定义作用域不是全局，有什么办法解决吗?

Quartus Standard版本，如果需要用到define文件里的宏定义，把define文件加到工程的File List里就可以，软件会自动去找。 Quartus Pro版本，对于这种define的文件，要求必须用include语句加
2020-08-10 23:56:07 -0600 edited answer quartus 软件宏定义作用域不是全局，有什么办法解决吗?

Quartus Standard版本，如果需要用到define文件里的宏定义，把define文件加到工程的File List里就可以，软件会自动去找。 Quartus Pro版本，对于这种define的文件，要求必须用include语句
2020-08-10 23:55:16 -0600 edited answer quartus 软件宏定义作用域不是全局，有什么办法解决吗?

Quartus Standard版本，如果需要用到define文件里的宏定义，把define文件加到工程的File List里就可以，软件会自动去找。 Quartus Pro版本，对于这种define的文件，要求必须用include语句
2020-08-10 23:54:21 -0600 edited answer quartus 软件宏定义作用域不是全局，有什么办法解决吗?

Quartus Standard版本，如果需要用到define文件里的宏定义，把define文件加到工程的File List里就可以，软件会自动去找。 Quartus Pro版本，对于这种define的文件，要求必须用include语句
2020-08-10 23:53:44 -0600 edited answer quartus 软件宏定义作用域不是全局，有什么办法解决吗?

Quartus Standard版本，如果需要用到define文件里的宏定义，把define文件加到工程的File List里就可以，软件会自动去找。 Quartus Pro版本，对于这种define的文件，要求必须用include语句
2020-08-10 23:51:35 -0600 answered a question quartus 软件宏定义作用域不是全局，有什么办法解决吗?

Quartus Standard版本，如果需要用到define文件里的宏定义，把define文件加到工程的File List里就可以，软件会自动去找。 Quartus Pro版本，对于这种define的文件，要求必须用include语句加
2020-08-10 23:47:30 -0600 asked a question quartus 软件宏定义作用域不是全局，有什么办法解决吗?

quartus 软件宏定义作用域不是全局，有什么办法解决吗? quartus 软件宏定义作用域是全局？

2020-08-10 22:39:12 -0600 edited answer Intel 10M 在quartus 20.1 里进行FPGA PR的时间太长，在不改动设计的前提下有没有办法改善?

在Quartus 工程里的qsf文件里添加以下约束，可以缩短FPGA PR时间：

2020-08-10 22:36:44 -0600 edited answer Intel 10M 在quartus 20.1 里进行FPGA PR的时间太长，在不改动设计的前提下有没有办法改善?

在Quartus 工程里的qsf文件里添加以下约束，可以缩短FPGA PR时间： setglobalassignment -name ASIC_PROTOTYPING ON setglobalassignment -name ASICP
2020-08-10 22:35:36 -0600 edited answer Intel 10M 在quartus 20.1 里进行FPGA PR的时间太长，在不改动设计的前提下有没有办法改善?

在Quartus 工程里的qsf文件里添加以下约束，可以缩短FPGA PR时间： setglobalassignment -name ASIC_PROTOTYPING ON setglobalassignment -name ASICP
2020-08-10 22:35:28 -0600 marked best answer Intel 10M 在quartus 20.1 里进行FPGA PR的时间太长，在不改动设计的前提下有没有办法改善?

Intel 10M 在quartus 20.1 里进行FPGA PR的时间太长?
2020-08-10 22:35:28 -0600 received badge ● Scholar (source)
2020-08-10 22:35:05 -0600 edited answer Intel 10M 在quartus 20.1 里进行FPGA PR的时间太长，在不改动设计的前提下有没有办法改善?

在Quartus 工程里的qsf文件里添加以下约束，可以缩短FPGA PR时间： setglobalassignment -name ASIC_PROTOTYPING ON setglobalassignment -name ASICP
2020-08-10 22:34:01 -0600 answered a question Intel 10M 在quartus 20.1 里进行FPGA PR的时间太长，在不改动设计的前提下有没有办法改善?

在Quartus 工程里的qsf文件里添加以下约束，可以缩短FPGA PR时间： setglobalassignment -name ASICPROTOTYPING ON setglobalassignment -name ASICPROT
2020-08-10 22:27:00 -0600 asked a question Intel 10M 在quartus 20.1 里进行FPGA PR的时间太长，在不改动设计的前提下有没有办法改善?

Intel 10M 在quartus 20.1 里进行FPGA PR的时间太长，在不改动设计的前提下有没有办法改善? Intel 10M 在quartus 20.1 里进行FPGA PR的时间太长?

2018-11-13 03:02:38 -0600 received badge ● Teacher (source)
2018-11-13 03:01:03 -0600 answered a question CLOCK_DEDICATED_ROUTE约束语句的使用条件?

如果时钟输入引脚需要驱动不同时钟域的CMT(MMCM/PLL)模块， 那么需要约束CLOCKDEDICATEDROUTE=BACKBONE。 set_property CLOCK_DEDICATED_ROUTE BACKBONE [get
2018-11-13 02:30:00 -0600 answered a question 你们软件使用bin文件，bit和bin文件的区别？

.bit是二进制文件，包括三个部分：头部冗余信息、配置数据、尾部冗余信息。 头部信息：里面包含了当前工程名字、编译时间等信息，因此头部信息的长度是不确定的，72个字节左右。 配置数据流：以0xFF FF FF FF AA 99 55 6
2018-11-13 02:12:18 -0600 answered a question 怎么样获得Xilinx的官方技术支持？

点击 xilinx官网 选择Service Portal 点击Sign IN,登录后有个"TECHNICAL",描述需要问的问题，提交成功后Xilinx FAE会发邮件到预留的邮箱，直到问题解决。

2018-11-13 01:58:56 -0600 answered a question PC通过以太网连接不到板子，什么问题？

PlayerPro配置IP后，主板没有重新上下电 PlayerPro没有选择ETH模式 配置的IP地址有冲突 PC网线直连板子排查是否是网络问题

2018-11-13 01:52:38 -0600 answered a question 有检测PCIE的GTH端口是否完好的程序吗？

Self-Test检测高速连接器的普通IO(即PCIE子卡相关的控制信号)。 IBERT检测高速连接器的GTH IO，检测GTH QUAD的连通性。 检查是否使用PCIE相关的PWRON、PERSTN、PRSNTN、WAKE_N四个信号。
2018-11-13 01:37:36 -0600 edited answer 我们要做子板，有子板连接器型号和pcb封装吗？

子板连接器只有Cadence软件的封装库文件，如链接，密码：123456。在samtec官网可以查看连接器型号的其它软件版本的连接器库。

2018-11-13 01:36:41 -0600 edited answer 我们要做子板，有子板连接器型号和pcb封装吗？

子板连接器只有Cadence软件的封装库文件，如链接，密码：123456。在samtec官网可以查看连接器型号的其它软件版本的连接器库。

2018-11-13 01:36:06 -0600 edited answer 我们要做子板，有子板连接器型号和pcb封装吗？

子板连接器只有Cadence软件的封装库文件，如链接，密码：123456。在samtec官网可以查看连接器型号的其它软件版本的连接器库。

2018-11-13 01:35:21 -0600 edited answer 我们要做子板，有子板连接器型号和pcb封装吗？

子板连接器只有Cadence软件的封装库文件，如链接，密码：123456。在samtec官网可以查看连接器型号的其它软件版本的连接器库。

2018-11-13 01:35:21 -0600 received badge ● Editor (source)
2018-11-13 01:33:49 -0600 answered a question 我们要做子板，有子板连接器型号和pcb封装吗？

子板连接器只有Cadence软件的封装库文件，如下链接。在samtec官网可以查看连接器型号的其它软件版本的连接器库。 https://releaseportal.s2cinc.com/owncloud/s/OZYn12PPdMerKeY